H - Electricity – 04 – L
Patent
H - Electricity
04
L
H04L 12/56 (2006.01) H04L 12/26 (2006.01)
Patent
CA 2201184
An Ethernet switch which includes a plurality of medium access control (MAC) interface logic circuits each coupled to an associated output port operative to perform serial-to-parallel conversion for frames being received from an associated output port and parallel-to-serial conversion for frames being transferred to an associated output port and other interfacing functions. The switch has an internal bus, a buffer memory coupled to each of the MAC interface logic circuits at one end and to the internal bus at another end, a switch central processor coupled to the internal bus and a multi-channel Direct Memory Access (DMA) Controller coupled to the internal bus and to the switch central processor, operative to transfer incoming frames to an external memory and to transfer frames stored temporarily in external memory to their destination in accordance with instructions from the switch central processor. An external memory controller is coupled to the DMA Controller and to an external memory port. An expansion bus interface logic circuit is coupled to said DMA Controller and to an expansion bus port. The switch central processor performs frame address handling and controls transfer of incoming frames to their destination.
Interrupteur Ethernet comportant un certain nombre de circuits logiques d'interface de commande d'accès au support (MAC), reliés chacun à un port de sortie conçu pour procéder à la conversion série-parallèle des trames reçues d'un port de sortie qui leur est associé et la conversion parallèle-série des trames transférées à un port de sortie associé, ainsi qu'à d'autres fonctions d'interfaçage. L'interrupteur est consitué des éléments suivants : un bus interne; une mémoire-tampon reliée à chacun des circuits logiques d'interface de la commande d'accès au support par l'une de ses extrémités et au bus interne par son autre extrémité; une unité centrale de traitement reliée au bus interne; et un contrôleur d'accès direct en mémoire (DMA) multi-canaux reliant le bus interne et l'unité centrale de traitement de l'interrupteur, conçu pour transférer les trames entrantes vers une mémoire externe et pour transférer les trames enregistrées temporairement dans la mémoire externe vers leur destination d'après les indications de l'unité centrale de traitement de l'interrupteur. Un contrôleur de mémoire externe est relié au contrôleur d'accès direct en mémoire et à un port de mémoire externe. Un circuit logique d'interface de bus d'extension est relié au contrôleur d'accès direct en mémoire et à un port de bus d'extension. L'unité centrale de traitement de l'interrupteur s'occupe de l'adresse des trames et contrôle le transfert des nouvelles trames vers leur destination.
Alexander Thomas
Smith Bradley H.
Taylor Calvin S.
Nexus Law Group Llp
Pmc-Sierra Inc.
LandOfFree
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Profile ID: LFCA-PAI-O-1479743