Non-blocking pipelined cache

Details Non-blocking pipelined cache Non-blocking pipelined cache

G - Physics

06

F

G06F 13/16 (2006.01) G06F 12/08 (2006.01) G06F 13/20 (2006.01)

Patent

CA 2238586

A cache includes an address cache for storing memory addresses. An address queue is connected to the address cache for storing missed addresses in the order that the address cache is probed. A memory controller receives the missed addresses from the address queue. A data queue receives data stored at the missed addresses from the memory controller. A probe result queue is connected to the address cache for storing data cache line addresses and hit/miss information. A multiplexer connected to the data cache, the data queue, and the probe result queue selects output data from the data cache or the data queue depending on the hit/miss information.

L'invention est une antémémoire contenant une zone de stockage d'adresses mémoire. Un dispositif de mise en file d'attente des adresses qui est connecté à cette zone de stockage est utilisé pour stocker les adresses manquantes dans l'ordre où cette zone est sondée. Ce dispositif transmet les adresses manquantes à un contrôleur de stockage. Un dispositif de mise en file d'attente de données reçoit de ce contrôleur les données qui sont stockées aux adresses manquantes. Un dispositif de mise en file d'attente de résultats de sondage est connecté à la zone de stockage d'adresses et est utilisé pour stocker les adresses des lignes d'antémémoire et les informations de réussite et d'échec. Un multiplexeur connecté à l'antémémoire à données, au dispositif de mise en file d'attente des données et au dispositif de mise en file d'attente des résultats de sondage sélectionne les données de sortie de l'antémémoire à données ou du dispositif de mise en file d'attente des données selon les informations de réussite et d'échec stockées.

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