G - Physics – 11 – C
Patent
G - Physics
11
C
G11C 11/22 (2006.01) G11C 5/02 (2006.01) G11C 7/06 (2006.01) G11C 7/10 (2006.01) G11C 8/12 (2006.01) G11C 8/14 (2006.01)
Patent
CA 2420378
In a non-volatile passive matrix memory device (10) comprising an electrically polarizable dielectric memory material (12) exhibiting hysteresis between first and second sets (14; 15) of addressing electrodes constituting word lines (WL) and bit lines (BL) of the memory device. A memory cell (13) is defined in the memory material (12) at the overlap between a word line (WL) and a bit line (BL). The word lines (WL) are divided into segments (S) each segment sharing and being defined by adjoining bit lines (BL). Means (25) are provided for connecting each bit lines (BL) of a segment (S) with a sensing means (26) enabling simultaneous connections of all memory cells (13) of a word line segment (15) for readout via the bit lines (BL). Each sensing means (26) senses the charge flow in a bit line (BL) in order to determine a stored logicalvalue. In a readout method,a word line (WL) of a segment (S) is activated by setting its potential to a switching voltage Vs of the memory cell (13) during at least a portion of a read cycle, while keeping the bit lines (BL) of a segment (S) at zero potential, during which read cycle a logical value stored in the individual memory cells (13) is sensed by the sensing means (26).
Dans une mémoire (10) de matrice passive rémanente comprenant un matériau (12) de mémoire diélectrique polarisable de manière électrique qui présente une hystérésis entre des premier et second ensembles (14 ; 15) d'électrodes d'adressage, les électrodes du premier ensemble (14) sont des canaux mots (CM) et les électrodes du second ensemble (15) sont des canaux bits (CB) de la mémoire. Une cellule (13) de mémoire ayant une structure de type condensateur est formée dans le matériau (12) de la mémoire au niveau du chevauchement entre un canal mot (CM) et un canal bit (CB). Les canaux mots (CM) sont divisés en segments (S) par un organe de détection (26), ce qui permet des connexions simultanées de toutes les cellules (13) de la mémoire d'un segment (15) de canal mot pour l'extraction par les canaux bits (CB) du segment (S). Chaque organe de détection (26) détecte le flux de la charge dans un canal bit (CB) afin de déterminer une valeur logique stockée dans une cellule (13) de la mémoire formée par le canal bit (CB). Dans un procédé d'extraction d'une mémoire de ce type, un canal mot (CM) d'un segment S est activé selon un protocole par réglage de son potentiel par rapport à une tension de commutation Vs de la cellule (13) de la mémoire pendant au moins une partie du cycle de lecture tout en maintenant les canaux bits (CB) à un potentiel zéro durant le cycle de lecture duquel une valeur logique stockée dans les cellules individuelles (13) de la mémoire est détectée par l'organe de détection (26). Ce procédé peut être utilisé dans une mémoire de données volumétriques possédant une pluralité de couches empilées comprenant chacune une mémoire de matrice passive rémanente.
Carlsson Johan
Gustafsson Goran
Thompson Michael
Womack Richard
Robic
Thin Film Electronics Asa
LandOfFree
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Profile ID: LFCA-PAI-O-1657607