Optical decoding for manchester encoded signals

H - Electricity – 04 – J

Patent

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Details

H04J 14/00 (2006.01) G06E 1/02 (2006.01) H04B 10/06 (2006.01) H04L 12/56 (2006.01) H04Q 11/00 (2006.01)

Patent

CA 2169075

An optical code recognition unit (OCRU) for recognizing a predetermined n-bit optical code sequence coded using the Manchester code format, has an n-way splitter (7) having an input and n parallel outputs (7a). A plurality of gates (9a, 9b, 9c, 9d) are associated with the splitter outputs (7a), respective pairs of splitter outputs leading to each of the gates (9a, 9b, 9c) via a respective optical combiner (8a, 8b, 8c), and any remaining single splitter output leading directly to its gate (9d). Each of the splitter outputs (7a) is subject to a different delay of m half bit periods, where m = 0 to 2(n-1), the values of m being chosen such that, if a predetermined optical code sequence is applied to the splitter input, the '1's in the outputs of each of the pairs of splitter outputs (7a) reach the associated AND gates (9a, 9b, 9c) and the '1' in any remaining single splitter output (7a) reaches its AND gate (9d) at predetermined times such that all the gates are turned on.

Unité d'identification de code optique (OCRU) apte à identifier une séquence de code optique prédéterminée à n bits codée par la structure de codage Manchester et possédant un diviseur à n voies (7) comportant une entrée et n sorties parallèles (7a). Une pluralité de portes (9a, 9b, 9c, 9d) sont associées aux sorties (7a) du diviseur, les paires respectives des sorties du diviseur conduisant à chacune des portes (9a, 9b, 9c) par l'intermédiaire d'un multiplexeur optique respectif (8a, 8b, 8c), et toute sortie unique restante du diviseur conduisasnt directement à sa porte (9d). Chaque sortie (7a) du diviseur est soumise à un retard différent de m-périodes de demi-bits, m = 0 à 2(n-1), les valeurs de m étant sélectionnées de sorte que, si une séquence prédéterminée de code optique est appliquée à l'entrée du diviseur, les '1' des sorties de chaque paire de sorties (7a) du diviseur atteignent les portes ET associées (9a, 9b, 9c), et que le '1' de toute sortie unique restante du diviseur (7a) atteigne sa porte ET (9d) à des intervalles de temps prédéterminés de sorte que toutes les portes soient mises en fonction.

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