G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 13/374 (2006.01) H04B 1/707 (2006.01)
Patent
CA 2259257
A parallel packetized intermodule arbitrated high speed control data bus system which allows high speed communications between microprocessor modules in a more complex digital processing environment. The system features a simplified hardware architecture featuring fast FIFO queuing operating at 12.5 MHz, TTL CMOS compatible level clocking signals, single bus master arbitration, synchronous clocking, DMA, and unique module addressing for multiprocessor systems. The system includes a parallel data bus with sharing bus masters residing on each processing module decreeing the commzunication and data transfer protocols. Bus arbitration is performed over a dedicated serial arbitration line and each requesting module competes for access to the parallel data bus by placing the address of the receiving module on the arbitration line and monitoring the arbitration line for collisions.
La présente invention concerne un système de bus de commande et de données à haut débit arbitré par un module parallèle d'interconnexion de paquets et permettant des échanges de communications à haut débit entre des modules de microprocesseurs dans des environnements de traitement numérique très complexes. Le système présente une architecture matérielle simplifiée comprenant un dispositif de files d'attente rapide de type FIFO (premier entré, premier sorti) opérant à 12, 5 MHz, des signaux d'horloge de niveau compatibles TTL CMOS, un arbitrage de bus maître unique, une horloge synchrone, un accès direct à la mémoire (DMA) et un adressage unique des modules pour les systèmes multiprocesseurs. Le système comporte un bus de données parallèle avec un dispositif de partage des bus maîtres résidant dans chaque module de traitement afin de coordonner les protocoles de communication et de transfert de données. L'arbitrage du bus s'effectue à travers une ligne d'arbitrage série spécialisée et chaque module de requête recherche l'accès au bus de données parallèle en indiquant l'adresse du module destinataire sur la ligne d'arbitrage et en surveillant les éventuelles collisions sur celle-ci.
Interdigital Technology Corporation
Ridout & Maybee Llp
LandOfFree
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