Phase- and frequency detector

Details Phase- and frequency detector Phase- and frequency detector

G - Physics

01

R

G01R 25/08 (2006.01) G01R 23/10 (2006.01) G01R 23/12 (2006.01)

Patent

CA 2246375

In accordance with a first aspect of the invention a phase detector for measuring phase differences between K input signals is provided. The phase detector comprises a counter, K first registers and a first subtractor. Each first register receives the counter signal of the counter and a respective input signal for updating a counter value in response to timing information on the input signal. The first subtractor receives the counter values to generate phase difference representing values. In accordance with a second aspect of the invention, a frequency detector is provided. The first subtractor is substituted by a second subtractor and K second registers are included. Each second register is connected to a respective first register. Each second register receives the counter value of its first register and the same input signal as that of its first register for backing-up the counter value as a back-up counter value in response to the timing information on the input signal. The second subtractor subtracts, for each second register and its first register, the counter values thereof to generate a frequency representing value.

L'invention porte, selon un premier aspect, sur un détecteur de phase permettant de mesurer les écarts de phase entre un nombre K de signaux d'entrée. Le détecteur de phase comprend un compteur, un nombre K de registres d'une première série et un premier soustracteur. Chaque registre de la première série reçoit le signal de comptage du compteur et un signal d'entrée spécifique pour la mise à jour de la valeur de comptage en réponse à des informations de synchronisation sur le signal d'entrée. Le premier soustracteur reçoit les valeurs de comptage pour produire des valeurs représentatives des écarts de phase. Selon son deuxième aspect, l'invention porte sur un détecteur de fréquence. Le premier soustracteur fait place à un deuxième soustracteur et un nombre K de registres d'une deuxième série est inclus. Chacun des registres de la deuxième série est relié à un registre correspondant de la première. Chaque registre de la deuxième série reçoit la valeur de comptage de son premier registre et le même signal d'entrée que son premier registre pour sauvegarder la valeur de comptage, en tant que valeur de comptage de sauvegarde, en réponse aux informations de synchronisation sur le signal d'entrée. Le deuxième soustracteur soustrait, pour chacun des registres de la deuxième série et son registre correspondant de la première, les valeurs de comptage pour produire une valeur représentative de la fréquence.

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