Phase-locked loop

Details Phase-locked loop Phase-locked loop

H - Electricity

03

L

H03L 7/083 (2006.01) H03L 7/10 (2006.01) H03L 7/18 (2006.01)

Patent

CA 2351759

For prompt restoration of a PLL being in inactive state due to an abnormal oscillation of a voltage-controlled oscillator, it is checked that a frequency divider (4) provides a comparison signal (fc). 1f no compar- ison signal (fc) is detected, a phase comparator (1) is forced to decrease its output level temporarily to decrease the oscillating frequency of the volt- age-controlled oscillator (3). The method is suitable for generation of a wide range of sampling clocks to be used for the digital processing of ana- log video signals. (See formula)

De manière à restaurer rapidement le fonctionnement d'une boucle à phase asservie se trouvant dans un état inactif en raison d'une oscillation anormale d'un oscillateur à fréquence commandée, on vérifie qu'un diviseur de fréquence (4) délivre un signal de comparaison (fc). Si aucun signal de comparaison n'est détecté, on provoque une réduction temporaire du niveau de sortie d'un comparateur de phase (1) de manière à réduire la fréquence d'oscillation de l'oscillateur à fréquence commandée (3). Ce procédé permet la génération d'une large plage de signaux d'horloges d'échantillonnage destinés au traitement numérique de signaux vidéo analogiques.

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