Pipelined processor with simultaneous instruction execution

Details Pipelined processor with simultaneous instruction execution Pipelined processor with simultaneous instruction execution

G - Physics

06

F

G06F 9/38 (2006.01)

Patent

CA 2044896

An information processing apparatus includes a data control circuit, an information holding register, and a selector. The data control circuit has control information corresponding to instructions which can be simultaneously executed, and performs control, even if a result of a preceding instruction is not stored in a general register, so as to execute a subsequent instruction to update the same general register. The information holding register holds data determination information based on an instruction preceding a branch instruction immediately before the branch instruction is executed. The selector replaces data determination information, for an instruction which is not executed upon a branch success, with data determination information held by the information holding register.

L'invention est un appareil de traitement d'informations comprenant un circuit de commande de données, un registre de stockage d'informations et un sélecteur. Le circuit de commande de données contient des informations de commande en rapport avec des instructions qui peuvent être exécutées simultanément et, même si le résultat d'une instruction antérieure n'est pas stocké dans un registre général, il commande l'exécution d'une instruction ultérieure pour mettre à jour ce registre général. Le registre de stockage d'informations saisit des informations de détermination des données basées sur l'instruction qui précède une instruction de branchement immédiatement avant l'exécution de cette dernière. Dans le cas d'une instruction qui n'est pas exécutée à la suite d'un branchement réussi, le sélecteur remplace les informations de détermination de données par les informations de détermination de données conservées dans le registre de stockage d'informations.

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