G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 12/10 (2006.01)
Patent
CA 2612838
A processor includes a memory configured to store data in a plurality of pages, a TLB, and a TLB controller. The TLB is configured to search, when accessed by an instruction having a virtual address, for address translation information that allows the virtual address to be translated into a physical address of one of the plurality of pages, and to provide the address translation information if the address translation information is found within the TLB. The TLB controller is configured to determine whether a current instruction and a subsequent instruction seek access to a same page within the plurality of pages, and if so, to prevent TLB access by the subsequent instruction, and to utilize the results of the TLB access of a previous instruction for the current instruction.
Cette invention concerne un processeur qui comprend une mémoire conçue pour enregistrer des données dans une pluralité de pages, un répertoire de pages actives (répertoire TLB) et un contrôleur de TLB. Le répertoire TLB est conçu pour rechercher, au moment de l'accès par une instruction ayant une adresse virtuelle, les informations de traduction d'adresse qui permettent de traduire l'adresse virtuelle en une adresse physique de l'une des pluralités de pages, et pour fournir l'information de traduction d'adresse, lorsque celle-ci se trouve dans le répertoire TLB. Le contrôleur de TLB est conçu pour déterminer si une instruction courante et une instruction suivante cherche à accéder à une même page de la pluralité des pages et, le cas échéant, pour empêcher l'accès au répertoire TLB par l'instruction suivante, et pour utiliser les résultats de l'accès au répertoire TLB par une instruction précédente pour l'instruction courante.
Augsburg Victor Roberts
Bridges Jeffrey Todd
Dieffenderfer James Norris
Kopec Brian Joseph
Sartorius Thomas Andrew
Qualcomm Incorporated
Smart & Biggar
LandOfFree
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Profile ID: LFCA-PAI-O-1844907