G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 9/44 (2006.01) G06F 17/50 (2006.01)
Patent
CA 2502892
A system and method for compiling computer code written to conform to a high- level language standard to generate a unified executable containing the hardware logic for a reconfigurable processor, the instructions for a traditional processor (instruction processor), and the associated support code for managing execution on a hybrid hardware platform. Explicit knowledge of writing hardware-level design code is not required since the problem can be represented in a high-level language syntax. A top-level driver invokes a standard-conforming compiler that provides syntactic and a semantic analysis. The driver invokes a compilation phase that translates the CFG representation being generated into a hybrid controlflow-dataflow graph representation representing optimized pipelines logic which may be processed into a hardware description representation. The driver invokes a hardware description language (HDL) compiler to produce a netlist file that can be used to start the place- and-route compilation needed to produce a bitstream for the reconfigurable computer. The programming environment then provides support for taking the output from the compilation driver and combining all the necessary components together to produce a unified executable capable of running on both the instruction processor and reconfigurable processor.
L'invention concerne un système et un procédé de compilation d'un code informatique écrit de manière à s'adapter à un standard de langage haut niveau afin de générer un programme exécutable unifié contenant la logique matérielle pour un processeur reconfigurable, les instructions pour un processeur traditionnel (processeur d'instruction) et le code support associé pour la gestion de son exécution sur une plate-forme matérielle hybride. Nul besoin d'avoir une connaissance explicite du code de conception du niveau matériel d'écriture tant que le problème peut être représenté dans une syntaxe de langage haut niveau. Un pilote de premier niveau appelle un compilateur conforme au standard offrant une analyse syntaxique et sémantique. Le pilote appelle une phase de compilation traduisant la représentation CFG générée sous forme de représentation graphique flux de commande-flux de données hybrides représentant une logique de pipe-line optimisée susceptible d'être traitée sous forme de représentation de description matérielle. Le pilote appelle un compilateur de langage de description matériel (HDL) afin d'obtenir un fichier contenant une liste d'interconnexions que l'on peut utiliser pour initialiser la compilation de placement et de routage nécessaire pour produire un train de bits pour l'ordinateur reconfigurable. L'environnement de programmation assure par la suite le support de prise de la sortie provenant du pilote de compilation et de combinaison de tous les composants nécessaires afin d'obtenir un programme exécutable unifié pouvant tourner sur le processeur d'instruction et le processeur reconfigurable à la fois.
Barker David
Brooks Jeffrey Paul
Hammes Jeffrey
Krause Lisa
Poznanovic Daniel
Gowling Lafleur Henderson Llp
Src Computers Inc.
LandOfFree
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