G - Physics
06
F
G06F 15/82 (2006.01)
Patent
CA 2689248
A processing apparatus comprises a plurality of processors (12), each arranged to perform an instruction, and a bus (20) arranged to carry data and control tokens between the processors. Each processor (12) is arranged, if it receives a control token via the bus, to carry out the instruction, and on carrying out the instruction, to perform an operation on the data, to identify any of the processors (12) which are to be data target processors, and to transmit output data to any identified data target processors, to identify any of the processors which are to be control target processors, and to transmit a control token to any identified control target processors.
La présente invention concerne un appareil de traitement comportant une pluralité de processeurs (12), chacun étant agencé pour exécuter une instruction, et un bus (20) agencé pour transporter des données et des jetons de contrôle entre les processeurs. Chaque processeur (12), s'il reçoit un jeton de commande via le bus, est agencé pour exécuter l'instruction et lors de l'exécution de l'instruction, d'effectuer une opération sur les données, pour identifier certains des processeurs (12) qui doivent être des processeurs cibles de données, et pour transmettre des données de sortie vers des processeurs cibles de données identifiés, pour identifier certains des processeurs qui doivent être des processeurs cibles de commande, et pour transmettre un jeton de contrôle à des processeurs cibles de commande identifiés.
Norton Rose Or S.e.n.c.r.l. S.r.l./llp
The University Of Reading
LandOfFree
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Profile ID: LFCA-PAI-O-1525766