Programmable gate array

Details Programmable gate array Programmable gate array

H - Electricity

03

K

H03K 19/00 (2006.01) H03K 19/173 (2006.01)

Patent

CA 2305728

An array includes a set of cells (21, 23, 25, 27, 29, 31). At least one of which includes a threshold gate (33, 35) having a plurality of inputs, an output, and a threshold value. Signals may assume an ASSERTED state having a logic meaning and a NULL state that has no logic meaning. The gate output switches to NULL when all inputs are NULL, and switches to the ASSERTED state when the number of ASSERTED inputs exceeds the threshold value. In the preferred embodiment, the gate exhibits hysteresis such that the output remains ASSERTED while the number of ASSERTED inputs remains greater than zero and less than the threshold value. In an alternate embodiment, an array of simplified threshold elements is used to form more complex threshold gates.

On décrit un circuit prédiffusé programmable permettant de mettre en oeuvre une logique asynchrone. Dans une forme de réalisation, le circuit comprend une série de cellules, dont au moins une comprend un circuit à seuil doté de plusieurs entrées, d'une sortie et d'une valeur de seuil. Les signaux peuvent présenter un état ACTIVE dans lequel il existe une signification logique et un état NUL qui ne possède de signification logique. La sortie du circuit s'inverse sur la position NUL lorsque toutes les entrées sont NUL, et le circuit s'inverse sur l'état ACTIVE lorsque le nombre d'entrées ACTIVE dépasse la valeur de seuil. Dans la forme de réalisation préférée, le circuit présente une hystérésis de sorte que la sortie reste ACTIVE alors que le nombre d'entrées ACTIVE reste supérieur à zéro mais inférieur à la valeur de seuil. Dans une autre forme de réalisation, un réseau d'éléments de seuil simplifié est utilisé pour former des circuits à seuil plus complexes.

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