Recoded radix-2 pipelined fft processor

G - Physics – 06 – F

Patent

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Details

G06F 17/14 (2006.01)

Patent

CA 2532710

A single-path delay feedback pipelined fast Fourier transform processor comprising at least one set of triplet FFT stage means: a first FFT stage means comprising a radix-2 butterfly, a feedback memory, and a multiplication by unity; a second FFT stage means comprising a trivial coefficient pre- multiplication, a radix-2 butterfly, a feedback memory, and a multiplication by selectable unity or Wnn/8; and a third FFT stage means comprising a trivial coefficient pre-multiplication, a butterfly, a feedback memory, and a complex twiddle coefficient multiplication with coefficients determined using a twiddle factor decomposition technique.

Cette invention concerne un processeur de transformée de Fourier rapide pipeline à rétroaction différée monovoie comprenant au moins un ensemble d'étages FFT triplet, à savoir : un premier étage FFT comprenant un papillon de radix-2, une mémoire à rétroaction et une multiplication par unité ; un deuxième étage FFT comprenant une pré-multiplication de coefficients triviaux, un papillon de radix-2, une mémoire à rétroaction et une multiplication par unité pouvant être sélectionnée ou par W<SB>N</SB><SP>N/8</SP> ; et un troisième étage FFT comprenant une pré-multiplication de coefficients triviaux, un papillon, une mémoire à rétroaction et une multiplication de coefficients de retouche complexes, les coefficients étant déterminés à l'aide d'une technique de décomposition de facteurs de retouche.

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