G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 1/24 (2006.01)
Patent
CA 2147568
A processor outputs a state signal representing the process state to a reset circuit. Upon reception of a reset signal from an external reset switch, the reset circuit outputs the reset signal to the reset terminal of the processor under the condition that the state signal allows a reset operation. The reset circuit also has a counter for starting a count operation upon reception of an externally input reset signal. Even when the processor is in a runaway state and cannot output the state signal for allowing the reset operation, a forced reset signal is supplied to the processor after a predetermined time is counted by the counter.
Un processeur transmet à un circuit d'initialisation un signal d'état représentant l'état d'un processus. € la réception d'un signal d'initialisation provenant d'un commutateur d'initialisation externe, ce circuit d'initialisation transmet ce signal d'initialisation à la borne d'initialisation du processeur sous la condition que le signal d'état autorise l'initialisation. Le circuit d'initialisation est doté d'un compteur qui lance une opération de comptage à la réception du signal d'initialisation externe. Même quand le processeur est dans un état d'emballement et ne peut émettre le signal d'état nécessaire pour autoriser l'initialisation, un signal d'initialisation forcé est fourni au processeur après une période prédéterminée mesurée par le compteur.
Hirotani Takayuki
Kaneko Katsuyoshi
Moriya Kouji
Orimoto Takashi
Watanabe Kazuyoshi
Casio Computer Co. Ltd.
Ridout & Maybee Llp
LandOfFree
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Profile ID: LFCA-PAI-O-1643466