Sampling filter using multiple clocks

H - Electricity – 03 – H

Patent

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Details

H03H 7/01 (2006.01) H03K 17/00 (2006.01) H03M 1/36 (2006.01)

Patent

CA 2705479

Methods and devices for forming a series of samples of a filtered version of an input signal. Multiple tap current cells each generate a tap current from the signal. Multiple distribution means couple the tap current cells with multiple integrating means. The distribution means is controlled by a first clock signal. The multiple integrating means integrate tap currents that they receive and these integrating means form the samples. The tap currents generated are each sent to each integrating means in a precetermined sequence according to the first clock signal. The integrating means each use integrating and samping phases controlled by a second clock signal. During the integrating phase an integrating means receives tap currents in sequence, while during the rest phase, no tap currets are received and the contents of the circuit are sampled and the integrator means is reset.

La présente invention concerne des procédés et des dispositifs permettant de former une série d'échantillons d'une version filtrée d'un signal d'entrée. Une pluralité de cellules de courant de dérivation génèrent chacune un courant de dérivation à partir du signal. Une pluralité de moyens de distribution couple les cellules de courant de dérivation avec de nombreux moyens d'intégration. Les moyens de distribution sont régulés par un premier signal d'horloge. La pluralité des moyens d'intégration intègrent les courants de dérivation qu'ils reçoivent et ces moyens d'intégration forment les échantillons. Les courants de dérivation générés sont chacun transmis vers chaque moyen d'intégration dans une séquence prédéterminée en fonction du premier signal d'horloge. Les moyens d'intégration utilisent chacun des phases d'intégration et d'échantillonnage régulées par un deuxième signal d'horloge. Lors de la phase d'intégration, un moyen d'intégration reçoit des courants de dérivation en séquence, alors que lors de la phase de repos, aucun courant de dérivation n'est reçu et le contenu du circuit est échantillonné et le moyen d'intégration est remis à zéro.

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