Secure communication interface for secure multi-processor...

G - Physics – 06 – F

Patent

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Details

G06F 12/14 (2006.01) G06F 21/00 (2006.01)

Patent

CA 2737145

A secure communication interface for a secure multi-processor system is disclosed. The secure communication interface can include a secure controller that is operable to transfer data between a first memory that is directly accessible by a first (master) processor and a second memory that is directly accessible by a secure second (slave) processor in the multi-processor system. One or more control and status registers accessible by the processors facilitate secure data transfer between the first memory and a memory window defined in the second memory. One or more status and violation registers shared by the processors can be included in the secure communication interface for facilitating secure data transfer and for reporting security violations based on a rule set.

La présente invention concerne une interface de communication sécurisée destinée à un système multiprocesseur sécurisé. L'interface de communication sécurisée peut comprendre un contrôleur sécurisé qui fonctionne de manière à transférer des données entre une première mémoire qui est accessible directement par un premier processeur (maître) et une seconde mémoire qui est accessible directement par un second processeur (esclave) sécurisé dans le système multiprocesseur. Un ou plusieurs registres d'état et de contrôle accessibles par les processeurs facilitent le transfert de données sécurisé entre la première mémoire et une fenêtre de mémoire définie dans la seconde mémoire. Un ou plusieurs registres d'état et de violation partagés par les processeurs peuvent être compris dans l'interface de communication sécurisée pour faciliter le transfert des données sécurisé et pour rapporter les violations de sécurité sur la base d'une règle définie.

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