Secure scan

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G - Physics

01

R

G01R 31/28 (2006.01) G01R 31/02 (2006.01) G01R 31/317 (2006.01) G01R 31/3185 (2006.01) H04L 9/32 (2006.01)

Patent

CA 2483978

According to the invention, a circuit that is capable of automated scan testing is disclosed. Included in the circuit are a cryptographic engine, a digital circuit, an input pin, and an output pin. The cryptographic engine capable of performing at least one of encryption and decryption of one or more digital signals. The digital circuit includes combinatorial logic and a number of memory cells. The memory cells have scan inputs connected serially in a scan chain. The input pin and output pin are coupled to the scan chain. At least one of the input pin and the output pin carries at least some cipher text data of the scan chain.

L'invention concerne un circuit pouvant faire l'objet d'un test série automatisé. Ce circuit comprend un moteur de chiffrement, un circuit numérique, une broche d'entrée et une broche de sortie. Ledit moteur de chiffrement peut effectuer au moins un chiffrement et un déchiffrement d'un ou de plusieurs signaux numériques. Ledit circuit numérique comprend une logique combinatoire et un certain nombre de cellules mémoire. Ces cellules mémoire peuvent présenter des entrées de test connectées en série dans une chaîne de test. Lesdites broches d'entrée et de sortie sont raccordées à ladite chaîne de test. Au moins une des broches d'entrée et de sortie comporte au moins certaines données de texte chiffré de ladite chaîne de test.

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