Solid-state imaging device, method of driving solid-state...

H - Electricity – 04 – N

Patent

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Details

H04N 3/15 (2006.01) H04N 5/335 (2006.01) H04N 9/04 (2006.01)

Patent

CA 2213250

In all-pixel reading image sensor or a noninterlaced output image sensor, an interlaced signal can selectively be output without the use of a frame memory or the like as an external circuit. For outputting an interlaced signal from a three-layer three-phase drive all-pixel reading CCD image sensor, vertical shift registers 2 are supplied with first through third vertical transfer pulses to transfer signal charges in the pixels of an nth line, for example, to a horizontal shift register 4, and then the horizontal shift register 4 is supplied with horizontal transfer pulses to transfer (shift) the signal charges of the nth line stored in the horizontal shift register 4 by two pixels, for example, to an output unit. Thereafter, the vertical shift registers 2 are supplied with first through third vertical transfer pulses to transfer signal charges in the pixels of an (n + 1)th line to the horizontal shift register 4, in which the signal charges of the nth line and the signal charges of the (n +1)th line are mixed with each other.

Le but de l'invention est de permettre à un détecteur d'image du type lisant tous les éléments de l'image ou à un détecteur d'image du type à sortie non entrelacée de fournir sélectivement une sortie du type entrelacé sans utiliser de mémoire à trames, etc. dans son circuit externe. Quand un détecteur d'image CCD à semi-conducteurs, lisant tous les éléments de l'image en trois phases et sur trois couches, est commandé pour fournir des signaux de sortie entrelacés, les charge des signaux de la n-ième ligne accumulés dans un registre de transfert horizontal (4) sont transférées (décalées) vers le côté sortie, par exemple par deux éléments d'images en appliquant une impulsion de transfert horizontale au registre (4) après transfert des charges des signaux, par exemple, à l'élément d'image de la n-ième ligne vers le registre (4) en fournissant des première à troisième impulsions de transfert vertical à un registre de transfert vertical (2). Ensuite, les charges des signaux à un élément d'image de la (n+1)-ième ligne sont transférées vers le registre (4) en fournissant les première à troisième impulsions de transfert vertical au registre (2) et les charges des signaux de la (n+1)-ième ligne sont mélangées avec les charges des signaux de la n-ième ligne dans le registre (4).

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