Split array dipole moment detection and localization

Details Split array dipole moment detection and localization Split array dipole moment detection and localization

G - Physics

01

R

G01R 33/10 (2006.01) G01B 7/00 (2006.01) G01V 3/08 (2006.01) G01V 3/40 (2006.01)

Patent

CA 2096261

A dipole moment detection and localization process and apparatus (10) in which the processing is applied to a single linear array of sensors (11) adapted to sense magnetic dipoles (13), and wherein data from the sensors (11) are processed as if it were derived from sets of subarrays (11a, 11b) of sensors. The apparatus (10) comprises a linear sensor array (11) whose output is processed by separate dipole moment detection and location processors (21a, 21b), or a single processor that provides for parallel processing operation. Data from the plurality of subarrays (11a, 11b) of sensors are processed in terms of Anderson functions and are correlated. The individual outputs of each processor (21a, 21b), or parallel processing portion, is coupled to a multiplier (22) that is adapted to correlate the signals. The dot product of these two correlated output signals is then formed to yield data that is thresholded and displayed.

L'invention est constituée par un processus et un appareil de détection et de localisation de dipôles (10) dans lequel le traitement est effectué sur un seul réseau linéaire de capteurs (11) adapté pour détecter les dipôles magnétiques (13), et dans lequel les données produites par les capteurs (11) sont traitées comme si elles étaient obtenues d'ensembles de sous-réseaux (11a, 11b) de capteurs. L'appareil de l'invention (10) comprend un réseau de capteurs linéaires (11) dont le signal de sortie est traité par des processeurs de détection et de localisation de dipôles distincts (21a, 21b), ou par un processeur unique fonctionnant en mode de traitement parallèle. Les données produites par la pluralité de sous-réseaux (11a, 11b) de capteurs sont traitées au moyen de fonctions d'Anderson et sont corrélées. Les signaux de sortie de chacun des processeurs (21a, 21b), ou du processeur à traitement en parallèle, sont transmis à un multiplicateur (22) qui est adapté pour corréler ces signaux. Le produit scalaire de ces deux signaux de sortie corrélés est ensuite déterminé pour produire des données qui sont ensuite seuillées et affichées.

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