G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 15/00 (2006.01) G06F 12/00 (2006.01) G06F 13/16 (2006.01) G06F 15/16 (2006.01) G06F 15/167 (2006.01)
Patent
CA 2456179
A switch/network adapter port for clustered computers employing multi-adaptive processor elements (202) in a dual in-line memory module (DIMM) or RambusTM in- line memory module (RIMM) format to significantly enhance data transfer rates over that otherwise available through use of the standard peripheral component interconnect (PCI) bus. Particularly disclosed is a microprocessor-based computer system utilizing either a DIMM or RIMM physical format processor element for the purpose of implementing a connection to an external switch, network, or other device. In a particular embodiment, connections may be provided to either the PCI, accelerated graphics port (AGP) or system maintenance (SM) bus for purposes of passing control information to the host microprocessor or other control chips. The field programmable gate array (FPGA) based processing elements have the capability to alter data passing through it to and from an external interconnect fabric or device.
L'invention se rapporte à un port d'adaptateur commutation/réseau pour ordinateurs groupés utilisant des éléments (22) de processeurs multi-adaptatifs dans un format de module de mémoire à double rangée de connexions (DIMM) ou dans un format de module de mémoire en ligne Rambus (RIMM) capable d'améliorer de manière significative des taux de transferts de données par rapport à ceux différemment disponibles grâce à l'utilisation du bus PCI standard. Plus particulièrement, l'invention concerne un système informatique basé sur un microprocesseur, utilisant un élément de processeur au format physique DIMM ou RIMM afin d'établir une connexion avec un commutateur, un réseau ou un autre dispositif externe. Dans un mode de réalisation particulier, des connexions peuvent être établies avec le PCI, le port graphique accéléré (AGP) ou le bus de maintenance du système (SM) afin de transmettre des informations de contrôle au microprocesseur hôte ou à d'autres puces de contrôle. Les éléments de traitement fondés sur le réseau de portes programmable (FPGA) sont capables de modifier les données qui traversent le réseau jusqu'à/depuis la matrice ou le dispositif d'interconnexion externe.
Burton Lee A.
Huppenthal Jon M.
Seeman Thomas R.
Gowling Lafleur Henderson Llp
Src Computers Inc.
LandOfFree
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Profile ID: LFCA-PAI-O-1887980