H - Electricity – 04 – B
Patent
H - Electricity
04
B
H04B 1/69 (2006.01) H04B 1/707 (2006.01) H04L 7/00 (2006.01)
Patent
CA 2224990
A method is disclosed for synchronizing, in the presence of sign ambiguity, to a pseudo random maximal length sequence having a characteristic polynomial of order k with a coefficients vector A given by: A = [1 a1 a2 ... ak-1 1] where each of the coefficients a1 to ak-1 is 1 for an intermediate tap location and otherwise is 0. A received symbol sequence is supplied to and shifted through a K = k + 1 stage shift register with P intermediate taps in positions determined by a coefficeints vector Ain given by: Ain = [1 <o>a</o>1 (a1Oa2) (a2Oa3) ... (ak-2Oak-1) <o>a</o>k-1 1] where <o>a</o>1 and <o>a</o>k-1 are the inverse of a1 and ak-1 respectively and O denotes a modulo-2 sum, whereby the shift register has P intermediate taps where P is a positive integer less than K. A respective correlation signal is recursively added at an input for the received symbol sequence and at each intermediate tap. Each correlation signal is produced by correlating the P + 1 signals from said input, intermediate taps, and output other than the signal to which the respective correlation signal is added. The invention is particularly applicable to pilot synchronization in CDMA terminals.
La présente invention concerne un procédé de resynchronisation en cas de signe ambigu, sur une suite pseudo-aléatoire de longueur maximale à polynôme caractéristique d'ordre k avec un vecteur A de coefficients tel que A = [1 a¿1? a¿2? ... a¿k-1? 1] chacun des coefficients a¿1? to a¿k-1? valant 1 pour un emplacement de piquage intermédiaire, et 0 dans les autres cas. Le procédé consiste à fournir une suite de symboles reçus et à lui faire subir un décalage au moyen d'un registre à décalage de niveau K = k + 1 fonctionnant pour P piquages intermédiaires en des positions déterminées par un vecteur A¿in? de coefficients tel que A¿in? = [1 <o>a</o>¿1? (a¿1?Oa¿2?) (a¿2?Oa¿3?) ... (a¿k-2?Oa¿k-1?) <o>a</o>¿k-1? 1] étant l'inverse de <o>a</o>¿1? et <o>a</o>¿k-1? respectivement, et O représentant une somme modulo 2. En l'occurence, le registre à décalage fonctionne pour P piquages intermédiaires, P étant un entier positif inférieur à K. Le procédé consiste ensuite à ajouter de façon récursive un signal de corrélation respectivement pour chaque entrée correspondant respectivement à la séquence de symboles reçus et à chaque piquage intermédiaire. Chaque signal de corrélation est produit par corrélation des signaux P+1 de l'entrée considérée, avec les piquages intermédiaires et avec les sorties autres que le signal auquel on ajoute son signal respectif de corrélation. L'invention convient particulièrement au pilotage de synchronisation de terminaux AMDC.
Bakouline Mikhail
Chloma Alexandre
Kreindeline Vitali
Li Gang
Trofimov Iouri
Millard Allan P.
Nortel Networks Limited
Northern Telecom Limited
LandOfFree
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