Synchronous digital signal to asynchronous digital signal...

H - Electricity – 04 – J

Patent

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H04J 3/07 (2006.01)

Patent

CA 2077017

Improved jitter performance is realized in a desynchronizer for obtaining an asynchronous digital signal, e.g., a DS3 signal, from a received synchronous digital signal, e.g., a SONET STS-1 signal. The improved jitter performance results from the use of a unique dynamic bit leaking arrangement in conjunction with a digital phase locked loop and desynchronizing elastic store. An optimum bit leak interval is obtained by controllably leaking a greater number of shorter interval STS-1 bits than the number of received pointer adjustment bits.Additionally, the affect of random pointer adjustments and the superposition of randomly received pointer adjustments on a periodic sequence of received pointeradjustments is minimized by employing a "static" queue of pointer adjustment bits to be leaked. The queue is dynamically maintained at its "static" count so that there are always bits in the queue to be leaked at the desired optimum bit leak interval even in the presence of randomly received pointer adjustments.

Une performance de gigue améliorée est réalisée dans un désynchronisateur afin d'obtenir un signal numérique asynchrone, p. ex. un signal DS3, à partir d'un signal numérique synchrone reçu, p. ex. un signal SONET STS-1. La performance de gigue améliorée résulte de l'utilisation d'une configuration unique de fuite de bit dynamique conjointement avec une boucle numérique à phase asservie et une mémoire élastique de désynchronisation. Un intervalle de fuite de bit optimal est obtenu par fuite contrôlée d'un nombre de bits STS-1 à intervalle court supérieur au nombre de bits de réglage de pointeur reçus. En outre, l'effet de réglages de pointeurs aléatoires et la superposition de réglages de pointeurs reçus au hasard à une séquence périodique de réglages de pointeurs reçus est réduit au minimum au moyen d'une file « statique » de bits de réglage de pointeurs de fuite. La file est maintenue dynamiquement à son compte « statique » de sorte qu'elle comporte toujours des bits de fuite selon l'intervalle de fuite de bits optimal désiré même en présence de réglages de pointeurs reçus au hasard.

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