H - Electricity – 04 – L
Patent
H - Electricity
04
L
H04L 29/06 (2006.01) H04L 12/56 (2006.01) H04L 29/08 (2006.01)
Patent
CA 2477668
A technique implements a novel high-speed high-density packet buffer utilizing a combination of high-speed and low-speed memory devices. The novel packet buffer is organized as a plurality of FIFO queues where each FIFO queue is associated with a particular input or output line. Each queue comprises a high- speed cache portion that resides in high-speed memory and a low-speed high- density portion that resides in low-speed high-density memory. The high-speed cache portion contains FIFO data that contains head and/or tail associated with the novel FIFO queue. The low-speed high-density portion contains FIFO data that is not contained in the high-speed cache portion.
L'invention concerne une technique qui met en oeuvre un nouveau tampon de paquets à forte densité utilisant une combinaison de mémoires à grande et faible vitesse. Ce nouveau tampon de paquets est organisé sous forme d'une pluralité de files d'attente FIFO, chaque file d'attente FIFO étant associée à une ligne d'entrée ou de sortie particulière. Chaque file d'attente comprend une partie mémoire cache à grande vitesse qui réside dans la mémoire à grande vitesse et une partie à forte densité et à faible vitesse qui réside dans la mémoire à faible vitesse et à forte densité. La partie mémoire cache à grande vitesse contient des données FIFO qui comprennent une tête et/ou une queue associées à la nouvelle file d'attente FIFO. La partie à faible vitesse et à forte densité contient des données FIFO qui ne sont pas comprises dans la partie mémoire cache à grande vitesse.
Key Kenneth M.
Mak Kwok Ken
Sun Xiaoming
Cisco Technology Inc.
Gowling Lafleur Henderson Llp
LandOfFree
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Profile ID: LFCA-PAI-O-1578300