Systems and methods for frame synchronization

H - Electricity – 04 – J

Patent

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Details

H04J 3/06 (2006.01)

Patent

CA 2498101

Systems and methods are disclosed for detecting framing data in a telecommunications signal. In one embodiment, a frame synchronizer circuit is provided that includes an interface for receiving bits of a telecommunications signal and storage for storing a framing state for the bit positions in the frame, the framing state for a given bit position indicating whether that bit position is a potential holder of the frame synchronization pattern. The frame synchronizer circuit also contains a state update function that determines the current-state for each bit position based on the bit position's previous state, and the value of the most recently received bit in that bit position. The encoding scheme makes use of shorter bit length symbols to represent statistically more frequently occurring states. In one embodiment, a single code word is used to record the state of a sequence of consecutively occurring bit positions that share the same state.

L'invention concerne des systèmes et des procédés permettant de détecter des données de mise en trame dans un signal de télécommunication. Dans un mode de réalisation, le circuit synchronisateur de trames comprend une interface pour recevoir des bits d'un signal de télécommunication et un moyen de stockage pour stocker un état de mise en trame pour les positions de bits de la trame, l'état de mise en trame pour une position de bit donnée indiquant si la position de bit est un porteur potentiel du motif de synchronisation de trames. Le circuit synchronisateur de trames contient également une fonction de mise à jour d'état déterminant l'état actuel pour chaque position de bits, en fonction de l'état de position de bits précédent, et la valeur du bit le plus récemment reçue dans cette position. Le programme de codage fait appel à des symboles de longueur de bit plus court pour représenter des états apparaissant statistiquement moins fréquemment. Dans un mode de réalisation, un mot à code unique est utilisé pour enregistrer l'état d'une séquence de positions de bit apparaissant de manière consécutive, et partageant le même état.

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