Timing closure methodology

Details Timing closure methodology Timing closure methodology

G - Physics

06

F

G06F 17/50 (2006.01)

Patent

CA 2317538

An automated method for designing an integrated circuit layout using a computer based upon an electronic circuit description and based upon cells which are selected from a cell library, each of the cells having an associated area, comprising the steps of: a) placing each of the cells in the integrated circuit layout so that the cells can be coupled together by wires to form a circuit path having an associated predetermined delay constraint wherein the cells are coupled together based upon the electronic circuit description input to the computer, b) connecting the cells together with the wires to form the circuit path; and c) adjusting an area of at least one of the cells to satisfy the associated predetermined delay constraint of the circuit path.

L'invention concerne un procédé automatisé pour concevoir un schéma d'implantation de circuits intégrés, à l'aide d'un ordinateur, sur la base d'une description des circuits électroniques et sur la base de cellules choisies dans une bibliothèque de cellules, chacune de ces cellules possédant une région associée. Ce procédé consiste a) à placer chacune des cellules dans le schéma d'implantation de circuits intégrés de sorte que ces cellules puissent être couplées les unes aux autres par des fils en vue de former un tracé de circuits présentant une contrainte de temps de propagation prédéterminée associée, les cellules étant couplées les unes aux autres sur la base de la description des circuits électroniques introduite dans l'ordinateur, b) à connecter les cellules les unes aux autres avec les fils en vue de former le tracé de circuits, et c) à régler une région d'au moins une des cellules en vue de satisfaire à la contrainte de temps de propagation prédéterminée associée du tracé de circuits.

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Profile ID: LFCA-PAI-O-1722192