G - Physics – 01 – R
Patent
G - Physics
01
R
G01R 31/319 (2006.01) G01R 31/317 (2006.01) G11C 29/00 (2006.01)
Patent
CA 2346883
Automatic test equipment for memory device testing with means for providing a high accuracy of transferring and receiving signals when testing a semiconductor device under test (DUT) by intelligent skew calibration of a timing system. The means for automatic skew calibration of a transceiver comprises a plurality of input registers (2, 3) for transmitting signals; a plurality of output registers (4, 5, 6) for receiving signals; a main clock driver (9) for generating a main clock signal; a reference clock driver (24) for generating reference signals for calibrating the registers; the said reference clock driver (24) being associated with the said main clock driver (9); and a plurality of phase shift means (12, 13, 14, 15, 16) comprising at least one set of phase shift means associated with each said plurality of registers, for the relative alignment of the register's timing within each plurality. The calibration is performed using a common time base which is distributed by means of a transmission line having predetermined wave characteristics.
Cette invention concerne un équipement automatique d'essai qui permet de tester des dispositifs de mémoire. Cet équipement comprend un système qui permet d'obtenir une grande précision lors du transfert et de la réception de signaux pendant l'analyse d'un dispositif à semi-conducteur à l'essai, ceci grâce au calibrage intelligent du décalage d'un système de synchronisation. Cette invention concerne plus précisément un système de calibrage automatique du décalage dans un émetteur-récepteur, lequel système comprend les éléments suivants: un groupe de registres d'entrée (2, 3) permettant d'émettre des signaux; un groupe de registres de sortie (4, 5, 6) permettant de recevoir des signaux; un pilote d'horloge principal (9) qui va générer un signal d'horloge principal, ainsi qu'un pilote d'horloge de référence (24) qui va générer des signaux de référence permettant de calibrer les registres, le pilote d'horloge de référence (24) étant associé au pilote d'horloge principal (9); et enfin, plusieurs systèmes de décalage de phase (12, 13, 14, 15, 16), lesquels comprennent au moins un ensemble de systèmes de décalage de phase associé à chaque groupe de registres, et assurent l'alignement relatif de la synchronisation des registres dans chaque groupe. Le calibrage se fait à l'aide d'une base temporelle commune qui est répartie par des lignes de transmission possédant des caractéristiques d'onde prédéterminées.
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Profile ID: LFCA-PAI-O-1622927