Secure electronic transaction system

Details Secure electronic transaction system Secure electronic transaction system

G - Physics

06

Q

G06Q 99/00 (2006.01)

Patent

CA 2642914

Systems and methods for the secure processing of electronic transactions are disclosed. In accordance with an exemplary embodiment, a system and method for the secure processing of electronic transactions comprises: receiving, by a POS terminal, information for a financial transaction card; receiving, by the POS terminal, information for a financial transaction; encrypting, by the POS terminal, the financial card information and the financial transaction information into a first encrypted message; transmitting the first encrypted message to a regional chassis; encrypting, by the regional chassis, the first encrypted message into a second encrypted message; transmitting the second encrypted message to a central chassis; decrypting, by the central chassis, the second encrypted message into a decrypted message; and transmitting the decrypted message to a host processor for authorization.

La présente invention concerne des systèmes et procédés de transactions électroniques sécurisées. Pour l'un des modes de réalisation, le système et le procédé de transactions électroniques sécurisées impliquent: la réception, par un terminal de point de vente, d'information se rapportant à une carte de transaction financière; la réception, par le terminal de point de vente, d'information se rapportant à une transaction financière; le cryptage, par le terminal de point de vente, d'information sur la carte financière et d'information sur la transaction financière donnant un premier message crypté; la transmission du premier message crypté à un boîtier régional, le cryptage du premier message crypté par le boîtier régional donnant un deuxième message crypté; la transmission du deuxième message crypté au boîtier central; le décryptage du deuxième message crypté par le boîtier central donnant un message décrypté; et la transmission du message décrypté à un processeur hôte pour autorisation.

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