G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 9/00 (2006.01) G06F 9/30 (2006.01) G06F 9/312 (2006.01) G06F 9/318 (2006.01) G06F 9/345 (2006.01) G06F 9/355 (2006.01) G06F 9/38 (2006.01)
Patent
CA 2366830
A double indirect method of accessing a block of data in a register file (818) is used to allow efficient implementations without the use of specialized vector processing hardware. In addition, the automatic modification of the register addressing is not tied to a single vector instruction nor to repeat or loop instructions. Rather, the technique, termed register file indexing (RFI) (820) allows full programmer flexibility in control of the block data operational facility and provides the capability to mix non-RFI instructions with RFI instructions. The block-data operation facility (814) is embedded in the iVLIW manArray architecture allowing its generalized use across the instruction set architecture without specialized vector instructions or being limited in use only with repeat or loop instructions. The use of RFI (820) in a processor containing multiple heterogeneous execution units (852 and 854) which operate in parallel, such as VLIW or iVLIW processors, allows for efficient pipelining of algorithms across multiple execution units (852 and 854) while minimizing the number of VLIW instructions required.
On utilise un procédé indirect double d'adressage d'un bloc de données dans un fichier registre (818) permettant des mises en oeuvre efficaces sans utiliser de matériel de traitement vectoriel spécialisé. En outre, la modification automatique de l'adressage de registre n'est liée ni à une seule instruction vectorielle ni à des instructions itératives ou en boucle. Cette technique, appelée adressage de fichier registre (RFI) (820) laisse une souplesse totale à un programmeur pour commander l'utilitaire d'exploitation de bloc de données, et offre la possibilité de mélanger des instructions non-RFI avec des instructions RFI. Cet utilitaire d'exploitation (814) de bloc de données est incorporé à l'architecture iVLIW de type à traitement matriciel multiple, ce qui permet son utilisation généralisée dans l'architecture d'ensemble d'instructions sans instructions vectorielles spécialisées ou son utilisation limitée uniquement avec des instructions itératives ou en boucle. L'utilisation de RFI (820) dans un processeur contenant plusieurs unités d'exécution (852 et 854) hétérogènes qui fonctionnent en parallèle, tels que des processeurs VLIW ou iVLIW, permet d'exécuter efficacement des algorithmes en cascade au niveau de plusieurs unités d'exécution (852 and 854), tout en réduisant le nombre d'instructions VLIW requises.
Barry Edwin Frank
Marchand Patrick R.
Pechanek Gerald G.
Barry Edwin Frank
Bops Incorporated
Kirby Eades Gale Baker
Marchand Patrick R.
Pechanek Gerald G.
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