H - Electricity – 04 – L
Patent
H - Electricity
04
L
H04L 29/06 (2006.01) H04L 12/56 (2006.01)
Patent
CA 2407310
A port queue includes a first memory portion having a first memory access time and a second memory portion having a second memory access time. The first memory portion includes a cache row. The cache row includes a plurality of queue entries. A packet pointer is enqueued in the port queue by writing the packet pointer in a queue entry in the cache row in the first memory. The cache row is transferred to a packet vector in the second memory. A packet pointer is dequeued from the port queue by reading a queue entry from the packet vector stored in the second memory.
Une file d'attente de port comprend une première section de mémoire dotée d'un premier temps d'accès à la mémoire et une seconde section de mémoire dotée d'un second temps d'accès à la mémoire. Ladite première section de mémoire comprend une rangée de mémoire cache. Cette rangée comporte plusieurs entrées de files d'attente. Un pointeur de paquet est mis en file d'attente dans la file d'attente de port par inscription du pointeur de paquet dans une entrée de file d'attente dans la rangée de mémoire cache de la première mémoire. Ladite rangée est transférée vers un vecteur de paquets dans la seconde mémoire. Un pointeur de paquets est retiré de la file d'attente du port par inscription d'une entrée de file d'attente provenant du vecteur de paquets stocké dans la seconde mémoire.
Borden Ladner Gervais Llp
Mosaid Technologies Incorporated
LandOfFree
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Profile ID: LFCA-PAI-O-1827565