G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 15/167 (2006.01)
Patent
CA 2228342
The first invention relates to a multi-processor system in which a bus arbiter permits an answer transfer request to utilize a bus utilization right with higher priority than a command transfer request, thereby increasing the processing efficiency of CPU boards. The second invention relates to a multi-processor system utilizing a system bus of a time split transfer system in which a data width of its own unit is inserted into a command and an answer transmitted and received between the processors and transmitted as bus width information, thus making it possible to interconnect a unit, which processes data of an arbitrary data width, to the system bus. In accordance with the third invention, local memories of a plurality of units connected to the system bus can be accessed via a bus interface of an input and output unit.
La première porte sur un système multiprocesseur dans lequel un arbitre de bus permet à une demande de transfert de réponse de se servir d'un droit d'utilisation de bus ayant une priorité plus élevée qu'une demande de transfert d'instruction, ce qui accroît le rendement de traitement des cartes de l'unité centrale. La deuxième porte sur un système multiprocesseur utilisant le bus système d'un système de transfert à découpage temporel dans lequel une largeur de donnée propre est introduite dans une instruction et dans une réponse transmise et reçue entre les processeurs et transmise comme information sur la largeur du bus, ce qui permet d'interconnecter au bus système une unité qui peut traiter des données de largeur quelconque. Dans la troisième invention, les mémoires locales d'une pluralité d'unités connectées au bus système sont rendues accessibles via une interface de bus d'unité d'entrée-sortie.
Okazaki Makoto
Shibata Yuji
Tanihira Hisamitsu
Fetherstonhaugh & Co.
Fujitsu Limited
LandOfFree
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Profile ID: LFCA-PAI-O-1974852