G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 15/167 (2006.01) G06F 15/16 (2006.01) G06F 15/17 (2006.01) H04Q 3/545 (2006.01)
Patent
CA 2202862
The present invention relates to a system and a method respectively for signal and data processing wherein in the format of the signals to be processed at least is divided into one control information part (HEAD) and a data part (BODY). The system comprises a central processor system and a regional processor system with a number of regional processors. The central processor system comprises at least one execution processor (IPU) and at least one signal processor (SPU). The signal processor (SPU) handles the signal processing between the processor systems comprising functions blocks in a centralized manner through so-called cooperation signals wherein each input signal is stored in the form of queue buffers. Control information and data are stored in a logically connected data queue area and the control information part and a pointer are stored in a signal buffer (JBU) of a signal processor (SPU) and the data part (BODY) is stored in a system memory (SM) or in a register memory (RM) of an execution processor. Upon execution are the control information part (HEAD) and the pointer transferred to the register memory (RM) of the execution processor (IPU).
La présente invention se rapporte à un système et à un procédé permettant de traiter respectivement des signaux et des données, les signaux à traiter se présentant sous un format dans lequel ils sont divisés en au moins une partie informations de commande (TETE) et une partie données (CORPS). Ce système comprend un système de processeurs centraux et un système de processeurs régionaux doté d'un certain nombre de processeurs régionaux. Le système de processeurs centraux comprend au moins un processeur d'exécution (IPU) et au moins un processeur de signaux (SPU). Ce dernier gère d'une manière centralisée le traitement des signaux entre les systèmes de processeurs comprenant des blocs de fonction par l'intermédiaire de signaux dits signaux de coopération, chaque signal d'entrée étant mémorisé sous forme de tampons de file d'attente. Des données et des informations de commande sont mémorisées dans une zone de file d'attente de données à connexion logique, la partie informations de commande, ainsi qu'un pointeur, sont mémorisés dans un tampon de signaux (JBU) d'un processeur de signaux (SPU), et la partie données (CORPS) est mémorisée dans une mémoire système (SM) ou dans une mémoire de registre (RM) d'un processeur d'exécution. La partie informations de commande (TETE) et le pointeur sont transférés, au moment de l'exécution, à la mémoire de registre (RM) du processeur d'exécution (IPU).
Avsan Oleg
Isaksson Nils
Wildling Klaus
Marks & Clerk
Telefonaktiebolaget Lm Ericsson
Telefonaktiebolaget Lm Ericsson (publ)
LandOfFree
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Profile ID: LFCA-PAI-O-2007413