H - Electricity – 04 – L
Patent
H - Electricity
04
L
H04L 1/20 (2006.01) H04L 1/00 (2006.01) H04L 1/08 (2006.01) H04L 25/02 (2006.01) H04L 29/02 (2006.01) H04B 1/707 (2006.01)
Patent
CA 2165342
A system for determining the rate at which data has been encoded in the receiver (12) of a variable-rate communications system. The data is received in symbols that are grouped in frames. When data is transmitted at full rate, the frame is filled with symbols. When the data is transmitted at less than full rate, symbols are repeated within a frame until the frame is full or the symbols are spaced apart within a frame. At an encoding rate of one fourth the full rate, for example, each symbol in the frame is repeated four times or data is transmitted one quarter of the time. The incoming frames one decoded, for example by decoder (48), and re-encoded, for example by encoder (76), at each possible data rate. A comparator, for example comparator (84), compares the re- encoded symbols with the originally received symbols and a counter, for example counter (100), counts the number of symbol errors. Each decoding process produces an indication of the quality of the decoding process which may include Cyclic Redundancy Check (CRC) results, for example CRC (120), or Yamamoto Quality Metrics. The counted errors and the quality indication comprise an error metric which is passed to a processor, for example microprocessor (56). The processor analysis the error metric for each data rate and determines the most probable rate at which the incoming symbols were encoded.
Système de détermination du débit de données codées dans le récepteur (12) d'un système de communications à débit variable. Les données sont reçues sous forme de symboles regroupés dans des trames. Lorsque le débit de transmission des données est maximal, la trame est remplie de symboles. Lorsque le débit de transmission des données est inférieur au débit maximal, les symboles sont répétés dans la trame jusqu'à ce qu'elle soit remplie, ou bien les symboles sont espacés les uns des autres à l'intérieur d'une trame. Lorsque le débit de codage est égal au quart du débit maximal, par exemple, chacun des symboles compris dans la trame est répété quatre fois, ou bien la transmission des données est quatre fois plus rapide. Les trames en entrée sont décodées, par exemple par un décodeur (48), puis codées de nouveau, par exemple par un codeur (76), pour chaque débit de données possible. Un comparateur (par exemple 84) compare les symboles de nouveau codés avec les symboles reçus initialement, et un compteur (par exemple 100) compte le nombre d'erreurs de symbole. Chaque processus de décodage produit une indication de la qualité du processus de décodage, qui peut renfermer les résultats d'un contrôle de redondance cyclique (CRC) tel que le CRC (120), ou des mesures de qualité de Yamamoto. Le total des erreurs et l'indication de qualité comportent une mesure d'erreurs qui est transmise à un processeur, par exemple le microprocesseur (56). Le processeur analyse la mesure d'erreurs pour chaque débit de données et détermine le débit auquel les symboles en entrée ont le plus probablement été codés.
Butler Brian K.
Padovani Roberto
Zehavi Ephraim
Qualcomm Incorporated
Smart & Biggar
LandOfFree
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