H - Electricity – 04 – Q
Patent
H - Electricity
04
Q
H04Q 3/00 (2006.01) H04L 12/56 (2006.01)
Patent
CA 2232696
A modular Fibre Channel switch includes a data switching path and a message switching path to provide logical point to point connections between switch ports. The data switching path includes a bank of shared SRAM memory devices that are accessed in a time-sliced protocol by each switch port. A receiving switch port writes a data frame to the bank of shared SRAM and the transmitting switch port then reads the data frame from the shared SRAM thereby effecting the logical point to point connection. Because the switch port includes a frame logic circuit that allows for an arbitrary start of frame address, each frame can be written to the first available DRAM device thuseliminating the need to buffer the data frame while waiting for a predetermined DRAM device to cycle in the time sliced protocol. The message switching path includes a message crossbar switch that is barrel shifted in a time sliced fashion to effect message passing among the switch ports. The switch includes a motherboard containing an embedded G_Port ASIC, a message crossbar switch to handle message passing and shared memory that is used to perform data switching. The switch also includes acentral processing unit daughter board and external switch port daughter boards.
L'invention est un commutateur de canaux à fibre optique modulaire utilisant un trajet de commutation de données et un trajet de commutation de messages pour établir des connexions de point à point logiques entre des ports de commutation. Le trajet de commutation de données comprend une batterie de SRAM mises en commun auxquelles chaque port de commutation a accès dans le cadre d'un protocole de découpage du temps. Un port de commutation du récepteur inscrit un bloc de données dans la batterie de SRAM mises en commun et le port de commutation de l'émetteur lit le bloc de données inscrit dans la batterie de SRAM, ce qui établit la connexion logique de point à point. Étant donné que le port de commutation comporte un circuit logique d'acheminement de blocs qui permet de choisir une adresse de début de bloc quelconque, chaque bloc peut être inscrit dans la première DRAM disponible, de sorte qu'il n'est pas nécessaire de mettre le bloc de données dans un tampon en attendant qu'une DRAM prédéterminée suive son cycle dans le cadre du protocole de découpage du temps. Le trajet de commutation de messages comprend un commutateur de messages crossbar dont l'actionnement est décalé sous la forme d'un découpage temporel pour transmettre les messages entre les ports de commutation. Le commutateur de l'invention comprend une carte mère sur laquelle sont montés un port enfoui G_ ASIC, un commutateur de messages crossbar servant à prendre en charge la transmission des messages et une mémoire mise en commun utilisée pour commuter les données. Il comprend également une unité de traitement centrale montée sur une carte fille, ainsi que des cartes filles à ports de commutation externes.
Banks David C.
Farnworth Steven L.
Ramsay Paul
Stoevhase Bent
Brocade Communications Systems Inc.
Sim & Mcburney
LandOfFree
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