Scalable high performance 3d graphics

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G - Physics

06

T

G06T 1/20 (2006.01) G06T 15/00 (2006.01)

Patent

CA 2480081

A high-speed ring topology. In one embodiment, two base chip types are required: a "drawing" chip, LoopDraw (110), and an "interface" chip, LoopInterface (105). Each of these chips have a set of pins that supports an identical high speed point to point unidirectional input and output ring interconnect interface: the LoopLink (125). The LoopDraw chip (110) uses additional pins to connect to several standard memories (115) that form a high bandwidth local memory sub-system. The LoopInterface chip (105) uses additional pins to support a high speed host computer host interface, at least one video output interface, and possibly also additional non-local interconnects to other LoopInterface chip(s) (105).

L'invention concerne une topologie en anneau grande vitesse. Dans un mode de réalisation décrit dans cette invention, deux puces de base sont nécessaires: une puce de "dessin", LoopDraw (110), et une puce "d'interface", LoopInterface (105). Chacune de ces puces comprend un ensemble de picots comprenant une interface d'interconnexion entre anneau d'entrée et anneau de sortie unidirectionnelle point à point grande vitesse identique: l'interface LoopLink (125). La puce LoopDraw (110) utilise des picots supplémentaires pour permettre la connexion à plusieurs mémoires standards (115) formant un sous-système mémoire local à grande largeur de bande. La puce LoopInterface (105) utilise des picots supplémentaires pour recevoir une interface hôte d'un ordinateur hôte, une interface de sortie vidéo, et éventuellement, des interconnexions non locales supplémentaires à une ou à plusieurs autres puces LoopInterface (105).

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